Segger: Eine IDE für Arm und RISC-V

Embedded-Entwicklung Segger: Eine IDE für Arm und RISC-V

11.01.2024 Von Michael Eckstein 2 min Lesedauer

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Programme für RISC-V- und Arm-Targets in einer integrierten Entwicklungsum-gebung erstellen und debuggen: Das verspricht Segger mit der Version 8.10 sei-nes Embedded Studios.

Eine Entwicklungsumgebung, zwei Architekturen: Die Multiplattform-IDE Embedded Studio kann mit Arm- und RISC-V-Kernen umgehen(Bild: Segger) — Eine Entwicklungsumgebung, zwei Architekturen: Die Multiplattform-IDE Embedded Studio kann mit Arm- und RISC-V-Kernen umgehen
(Bild: Segger)

Es gibt immer mehr Mikrocontroller und Systems-on-a-Chip, die neben omnipräsen-ten Arm-Kernen auch RISC-V-Cores einsetzen. Bislang war das Erstellen von Pro-grammen, die beide Architekturen nutzen, schwierig: Entwickler mussten unter-schiedliche Programmier- und Debugging-Umgebungen einsetzen. Segger verspricht nun mit der neuen Version 8.1 seiner integrierten Entwicklungsumgebung (IDE) Em-bedded Studio Abhilfe: Die Multiplattform-IDE unterstützt nun mehrere Architektu-ren mit einer Installation. Nach Angaben des Unternehmens ist es somit möglich, Programme für RISC-V- und Arm-Targets in der einheitlichen Entwicklungsumgebung zu erstellen und zu debuggen.

Die IDE unterstützt Intel- und Arm-basierte Plattformen und lässt sich auf Windows, Linux und auch macOS installieren. Laut Dirk Akemann, Marketing-Manager bei SEG-GER, arbeite die emRun-Laufzeit- und emFloat-Gleitkommabibliotheken, der intelli-gente SEGGER Linker und der hochoptimierende C/C++ SEGGER Compiler nahtlos zusammen. So ließen sich die Performance maximieren und die Codegröße minimie-ren. „Mit unseren benutzerfreundlichen Lizenzoptionen kann jeder Embedded Stu-dio selbst ausprobieren“, sagt Akemann.

Weitere Verbesserungen an Bord

Zu den weiteren Verbesserungen gehören neue Mechanismen für die Code-Vervollständigung, kontextabhängige Vorschläge und Diagnosen. Tooltipps liefern kontextabhängige Details zu jedem Teil des Codes. Warnungen, Fehler und Diagno-sen sind bereits während des Schreibens von Code verfügbar, ohne auf den Build des Projekts warten zu müssen.

Embedded Studio hat eine direkte Integration für J-Link. Durch die Integration des GDB Server-Protokolls unterstützt es nach Angaben des Herstellers außerdem prak-tisch jeden Debug-Probe. Zusätzlich ist jetzt eine direkte Integration für ST-Link ent-halten.

Während J-Link-Debug-Probes eine laut Segger „unvergleichliche“ Debug-Performance, ein umfangreiches Feature-Set und Unterstützung für Tausende von Geräten bieten, vereinfacht die native Integration von ST-Link den Einstieg in die Em-bedded-Entwicklung auf häufig verwendeten ST-Evaluierungsboards.

Mit Seggers 'Friendly License' ist Embedded Studio für unbegrenzte Evaluierung und für pädagogische und nicht-kommerzielle Zwecke kostenlos erhältlich, ohne Ein-schränkungen in Bezug auf Codegröße, Funktionen oder Nutzungsdauer. (me)

Blockschaltbild der selbst entwickelten RISC-V-CPU von Renesas: An den 32-Bit-Kern sind einige leistungssteigernde Erweiterungen angeflanscht. Renesas gibt 3,27 CoreMark/MHz Rechenleistung an. (Bild: Renesas Electronics)

Wollen die Open-Source-ISA RISC-V vorantreiben: Bosch, Infineon, NXP, Nordic Semi und Qualcomm gründen ein gemeinsames Unternehmen. (Bild: Qualcomm)

Die TRACE32-Debugging-Tools von Lauterbach unterstützen nun auch moderne System-on-Chips von Nvidia, NXP und Texas Instruments. (Bild: Lauterbach)

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Stand: 08.12.2025

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