Systemmodellierung Simulink-HDL-Coder

Der Simulink-HDL-Coder von The MathWorks generiert automatisch synthetisierbaren Hardware-Description-Language-(HDL-)Code aus Systemmodellen, die mit der Simulink- und Stateflow-Software

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The MathWorks GmbH

Der Simulink-HDL-Coder von The MathWorks generiert automatisch synthetisierbaren Hardware-Description-Language-(HDL-)Code aus Systemmodellen, die mit der Simulink- und Stateflow-Software erstellt wurden. Mit dem Coder können Target-unabhängiger Verilog- und VHDL-Code sowie automatisierte Tests und Prüfläufe (Testbenches) zur Implementierung und Verifikation von ASICs und FPGAs erzeugt werden. Simulink-HDL-Coder beschleunigt den Entwurf, die Implementierung und die Verifikation von Hardware durch die Bereitstellung eines direkten Pfades vom Systemmodell zum Code.

Der Coder generiert bit- und zyklusgenauen Verilog- und VHDL-Code aus 80 Standardblöcken in Simulink und dem Signal-Processing-Blockset sowie aus in Stateflow modellierten endlichen Zustandsautomaten nach Mealy und Moore. Der auf diese Weise generierte Code lässt sich in gängige Tools zur Implementierung und Verifikation von Hardware einbinden. Bereits bestehender HDL-Code und HDL-Code von Drittanbietern kann ebenfalls mit Simulink-Modellen verifiziert sowie in Programmcode integriert werden, der automatisch mittels des Simulink-HDL-Coder erzeugt wurde.

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