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18.09.2024
Transparente Mischung von VHDL & Verilog in einem Design
Entdecken Sie die Möglichkeiten von ModelSim
Verlassen Sie sich auf die preisgekrönte SKS-Technologie (Single Kernel Simulator) von ModelSim bei Verifikation und Simulation!
ModelSim ermöglicht die transparente Mischung von VHDL und Verilog in einem Design. Seine Architektur ermöglicht eine plattformunabhängige Kompilierung mit der hervorragenden Leistung von nativ kompiliertem Code.
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